400-885-9898
职位描述
VerilogVHDLC語言芯片設計仿真調試電子/半導體/集成電路
崗位職責：
1、參與項目需求分析, 研究項目技術細節，進行核心模塊的詳細設計；
2、能獨立進行FPGA單元架構設計，完成FPGA系統仿真，撰寫FPGA單元架構設計文檔；
3、分析并解決開發過程中的問題，FPGA的資源及時序優化；
4、配合軟、硬件設計工程師、系統測試工程師完成相關任務目標。
任職要求：
1、熟練Xilinx/Altera/Lattice其中一款器件的結構及設計流程；
2、熟練Verilog或者VHDL語言，熟悉C語言；
3、電子信息及相關專業，3年以上相關工作經驗。
備注：
1. 五天制7.5小時，周末雙休；
3. 完善的培訓學習體系，與中科院博士交流學習；
職位福利：項目獎金、周末雙休、全勤獎、試用期提前轉正、團隊氣氛活潑、年輕化團隊
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工作地点
廈門湖里區環島路與鰲山路交匯處(廈門航空港北區)港中路1690號2號南603
以担保或任何理由索要财物，扣押证照，均涉嫌违法。一经发现，
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