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工作職責 1.負責實現功能模塊的微結構設計、 RTL 邏輯設計、仿真和驗證。 2.配合后端芯片物理設計，回片后系統 SoC 調試。 任職要求 1.集成電路、電子信息技術、微電子、自動化、通信工程等相關專業，本科及以上學歷。 2.了解 STA 靜態時序分析。 3.熟悉 VCS、 NC、 Verdi 仿真調試工具。 4.熟練掌握 Verilog、 SystemVerilog、 Chisel 等硬件設計語言，具有良好的編程習慣。 5.有較強的電路分析及解決問題的能力，有較強的動手能力。 6.吃苦耐勞，有較強的自我驅動能力。 7.優先項： 有 AI 芯片、 codec 芯片、 RISC-V 處理器設計經驗者優先