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崗位職責：
1、負責高速數字電路板的原理圖設計，包括ddr3 sdram、flash、高速AD\DA、FPGA、高速串口板間互連等電路設計；
2、負責數字電路板的時鐘電路、濾波電路等設計，包括PLL時鐘產生電路、OCXO、VCXO等時鐘參考源電路設計，時鐘倍頻電路、時鐘同步電路等設計；
3、指導layout工程師進行電路分割布局，信號隔離干擾和電磁屏蔽以及散熱設計的考慮，指導完成高速線路的布線工作，保證信號完整性和電路的穩定性；
4、負責硬件的調試、測試，協助軟件、邏輯完成聯調；
5、完成設計資料歸檔、標準化等工作。
任職要求：
1、至少3年以上硬件設計經驗；
2、對模擬電路、數字電路技術有較好的設計基礎；
3、掌握高速信號設計；
4、熟練掌握Cadence、ALLEGRO等設計工具；
5、熟練掌握使用各種測試儀器設備；
6、有EMI/EMC知識和經驗者優先；
7、有V7、RFSOC等大規模FPGA、、高速AD\DA（204B）、ddr3 sdram、PCIE、VPX、CPCI等硬件設計經驗者優先。